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Eingebettete System Leiterplatte mit serieller Kommunication und CPLD
Diese mikrogrosse Leiterplatte ist ideal fuer Standardamwendungen, die eine
leistungfaehige 8bit CPU mit einem eher grossen Adressraum von 128k zusammen
mit einem unterstuetzenden CPLD benoetigen. Die 128
Makrozellen dieses CPLD erlauben eine Menge Zaehler auf derselben Frequenz
wie der Controller zu laufen. Dadurch koennen Zeitprobleme reduziert werden.
Eigenschaften
- 4 lagige Leiterplatte 5x10cm (2x4inches)fuer wenig elektronisches Rauschen
- Getaktete Stromversorgung zum Betrieb von 5.0 bis 5.5V, 20mA mit unprogrammiertem CLPD
- die L-typ CPU wuerde lauffaehig sein bis hinunter zu 3.3V
- die CPU ist eine Atmel AVR ATMEGA128 mit XTAL oder externem Clock, SPI programmiert
- externer Clock im DIP8 or DIP14 Gehaeuse, Frequenz ihrer Wahl
- XTAL in SMU4 Gehaeuse, Frequenz Ihrer Wahl
- Frequenbereich fuer die CPU ist bis 8MHz fuer die L-typ (3.3V) und bis 16MHz fuer den normalen Typ
- CPLD ist ein 128 Flipflop Altera Max3128-7 mit demselben Clock wie die CPU, JTAG programmiert
- Ein waehlbarer RS232 or RS422 Kanal
- 34 pin Steckverbinder (2x17 als 0.1" header) mit 32 I/O Signalen vom CPLD
- 50 pin Steckverbinder (2x25 als 0.1" header) mit 37 I/O vom CPLD plus den Clock plus die 8 A/D Kanaele der CPU
Eine USB version dieser Leiterplatte ist in Entwicklung und sollte im Sommer 05 rauskommen
Eine Version mit einem groesseren vielseitigeren FPGA ist auch geplant.
Empfohlene Entwicklungswerkzeuge sind das kostenlos herunterladbare Altera MaxPlus2 resp Quartus2
fuer das CPLD, und der imagecraft C Compiler
oder der E-Lab Pascal compiler fuer den AVR, beide erhaeltlich
fuer ein kleines Budget.
Sein Preis : 200 CHFr @ 1 ohne VAT
etwa 133 Euro (@ 1 CHFr = 0.666Euro)
etwa 167 USD (@ 1 CHFr = 0.833USD)
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letzte Erneuerung: 7.April.05 oder vielleicht spaeter
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